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（）是指链路层从发端收到高层的分组开始到收端将该分组呈送给高层为止所需的时间

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（）就是指物理层（比特管道）传输容量中用于有效分组传输所占的比例

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（）就是在给定的物理信道和输入分组流条件下，接收端能够呈送给高层的分组速率

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算法的正确性是指算法始终能够正常工作，正确接收输入的数据和状态，产生正确的动作和正确的输出结果

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在STop and Wait ARQ中，发端发送一帧，如果没有收到对方的ACK则发送下一帧

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在STop -and-Wait ARQ 中发端发送一个帧后，如果收到对方的NAK帧，则发送下一帧

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在Stop-And-Wait ARQ 中，发端发送一个帧后，如果收到对方的ACK帧，则重发这帧

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Stop-And-Wait ARQ基本思想是开始下一帧传送以前，必须确保当前帧已被正确接收

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设输入比特序列为（11010111），采用CRC-16生成多项式，求经过校验后的发送序列

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设信息序列长K=3，校验序列长L=4，若输入比特序列为（101），求其奇偶校验比特序列

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